{"id":4180,"date":"2016-06-24T08:00:23","date_gmt":"2016-06-24T10:00:23","guid":{"rendered":"http:\/\/inf.ufpel.edu.br\/site\/?p=4180"},"modified":"2016-06-24T08:00:23","modified_gmt":"2016-06-24T10:00:23","slug":"banca-de-tcc-gabriel-machado-balota","status":"publish","type":"post","link":"https:\/\/wp.ufpel.edu.br\/computacao\/ccomp\/banca-de-tcc-gabriel-machado-balota\/","title":{"rendered":"Banca de TCC: Gabriel Machado Balota"},"content":{"rendered":"

UNIVERSIDADE FEDERAL DE PELOTAS<\/strong>
\n CENTRO DE DESENVOLVIMENTO TECNOL\u00d3GICO<\/strong>
\n TRABALHO DE CONCLUS\u00c3O DE CURSO<\/strong><\/p>\n

Apresenta\u00e7\u00f5es Finais (2016\/1)<\/p>\n

Desenvolvimento de um IP\/Core para Estima\u00e7\u00e3o de Movimento em V\u00eddeos de Alta Defini\u00e7\u00e3o
\npor
\nGabriel Machado Balota<\/p>\n

Curso:
\nCi\u00eancia da Computa\u00e7\u00e3o<\/p>\n

Banca:
\nProf. Marcelo Schiavon Porto (orientador)
\nProf. Bruno Zatt (co-orientador)
\nProf. Daniel Munari Palomino
\nProf. Rafael Iankowski Soares<\/p>\n

Data: 27 de Junho de 2016<\/p>\n

Hora: 15:30h<\/p>\n

Local: Audit\u00f3rio da Reitoria<\/p>\n

Resumo do Trabalho:<\/p>\n

Atualmente, os v\u00eddeos digitais representam uma grande parte dos meios de comunica\u00e7\u00e3o mais utilizados. Os v\u00eddeos em alta defini\u00e7\u00e3o possuem um elevado volume de informa\u00e7\u00f5es e, por esse motivo, necessitam de compress\u00e3o para que sejam armazenados e transmitidos. Nos \u00faltimos anos, vem crescendo o n\u00famero de dispositivos eletr\u00f4nicos que s\u00e3o capazes de representar v\u00eddeos digitais, at\u00e9 mesmo dispositivos que possuem restri\u00e7\u00f5es de consumo de energia, mem\u00f3ria e processamento. O padr\u00e3o estado-da-arte para a codifica\u00e7\u00e3o de v\u00eddeo \u00e9 o High Efficiency Video Coding (HEVC), que foi proposto com o objetivo de duplicar as taxas de compress\u00e3o do seu antecessor, o padr\u00e3o H.264, mantendo a mesma qualidade visual do v\u00eddeo codificado. A codifica\u00e7\u00e3o de v\u00eddeo exige um elevado esfor\u00e7o computacional sobre um elevado volume de dados, que cresce proporcionalmente ao aumento da resolu\u00e7\u00e3o do v\u00eddeo, com isso, solu\u00e7\u00f5es de hardware dedicado s\u00e3o fundamentais, para atingir os requisitos de desempenho de energia. A estima\u00e7\u00e3o de movimento (ME \u2013 Motion Estimation) \u00e9 um dos m\u00f3dulos que exige mais processamento do codificador, devido ao elevado\u00a0 n\u00famero de compara\u00e7\u00f5es necess\u00e1rias para processar todos os blocos de um quadro. A utiliza\u00e7\u00e3o de IPs (Intellectual Property) apresenta uma flexibilidade e f\u00e1cil integra\u00e7\u00e3o com outros IPs, visto que utiliza interfaces padr\u00e3o para sistemas digitais. Logo, este trabalho de conclus\u00e3o de curso apresenta o desenvolvimento de um IP core para a estima\u00e7\u00e3o de movimento, utilizando estrat\u00e9gias de Electronic System Level (ESL). Para o projeto ESL foi utilizada a ferramenta Qsys System Integration Tool da Altera e foi padronizado com a interface Avalon-ST. Este IP foi sintetizado para um dispositivo FPGA (Field-Progammable Gate Arrays) e apresentou uma taxa de processamento de 34 quadros por segundo para uma resolu\u00e7\u00e3o HD 1080p (1920 x1080 pixels). Assim, esta solu\u00e7\u00e3o apresenta um IP com alto processamento, capaz de atingir desempenho para o processamento em tempo real, al\u00e9m de flexibilidade e f\u00e1cil integra\u00e7\u00e3o a outros IPs, visto que utiliza interfaces com padr\u00f5es industriais.<\/p>\n

Para mais informa\u00e7\u00f5es acesse: http:\/\/inf.ufpel.edu.br\/notcc\/doku.php?id=bancas:2016_1<\/a><\/p>\n","protected":false},"excerpt":{"rendered":"

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